- 用Python编写FPGA以太网MAC(附源码下载方式)
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来源：EETOP作者：ccpp123略作了解后发现,MyHDL不是高层次综合,它实际上是用Python的一些功能实现了一个Verilog仿真器,能对用Python写的仿Verilog语言进行仿...
- 基于FPGA的自适应MIMO-OFDM无线基带传输系统的研究
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谭凯1，彭端2（1.广东工业大学信息工程学院，广东广州510006；2.广东工业大学实验教学部，广东广州510006）针对自适应MIMO-OFDM无线基带传输系统，提出了一种并行复用的基4...
- 视频教程:Xilinx Model Composor 产品指南
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赛灵思自适应和智能计算的全球领导企业本视频将为您详细介绍赛灵思的ModelComposor工具，这是一款基于模型的全新设计工具，可以支持在MathWorksSimulink环境中进行快速设...
- 基于FPGA的ZYNQ平台，系统裸机条件，如何实例化vivado的FFT IP核
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本文基于Xilinx的ZYNQ平台，实现ARM系统如何调用底层FFTIP核实现相应算法。ZYNQ平台内部包括两部分，即PL和PS。PL为FPGA逻辑部分，PS为双核ARM9。FPGA与ARM9之...
- 新手做FPGA开发，需要注意哪些问题?
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学习FPGA技术到工作至今，经验是从实践中获得，多动手才是王道，对基础电路的理解可以从画PCB板层中慢慢理解掌握，记得之前行业师傅说过一句话，FPGA工程师在设计电路数字电路系统中，前提是：心中有电路...
- ZYNQ 入门笔记(一):开发流程
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概述ZYNQ的工程设计大体上可以分为对硬件逻辑系统的设计和对CPU软件程序的设计硬件逻辑系统设计：搭建一个满足用户需求的硬件环境，通过Vivado实现CPU程序设计：通过用户程序控制...
- 「正点原子FPGA连载」第十二章IP核之RAM实验
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1）摘自【正点原子】领航者ZYNQ之FPGA开发指南2）实验平台：正点原子领航者ZYNQ开发板3）平台购买地址：https://item.taobao.com/item.htm?&id=60616...
- 【超实用】一分钟学会用最小存储空间保存Vivado工程!
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在平常调试FPGA的过程中，大家会发现Vivado工程动辄数百兆大小，甚至几个G都很常见。如果调试的版本过多，就连几个T的硬盘也不够用。怎么办呢？其实，Vivado自带了一种使用tcl命令保存viva...
- 「超实用」一分钟学会用最小存储空间保存Vivado工程
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- VIVADO时序约束及STA基础
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一、前言 无论是FPGA应用开发还是数字IC设计，时序约束和静态时序分析（STA）都是十分重要的设计环节。在FPGA设计中，可以在综合后和实现后进行STA来查看设计是否能满足时序上的要求。本文阐述基...